考研網(wǎng) » 考試圖書 » 電子通信培訓(xùn)教材 » 數(shù)字邏輯與EDA設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書 丁磊 .. » 全部考試圖書分類

圖書簡(jiǎn)介

品牌：圖書

詳情

商品基本信息，請(qǐng)以下列介紹為準(zhǔn)
商品名稱：	數(shù)字邏輯與EDA設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書
作者：	丁磊
市場(chǎng)價(jià)：	21元
文軒網(wǎng)價(jià)：	16.4元【78折】
ISBN號(hào)：	9787560628523
出版社：	西安電子科技大學(xué)出版社
商品類型：	圖書

其他參考信息（以實(shí)物為準(zhǔn)）
裝幀：平裝	開本：	語(yǔ)種：中文
出版時(shí)間：2012-09-01	版次：1	頁(yè)數(shù)：
印刷時(shí)間：2012-08-01	印次：1	字?jǐn)?shù)：

內(nèi)容簡(jiǎn)介

丁磊等編著的《數(shù)字邏輯與EDA設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書》是《數(shù)字邏輯與EDA設(shè)計(jì)》的配套用書。《數(shù)字邏輯與EDA設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書》共分5章：第1章主要介紹自主研發(fā)的能完全滿足本課程實(shí)驗(yàn)需求的實(shí)驗(yàn)箱；第2章介紹基于實(shí)驗(yàn)箱的數(shù)字邏輯基本實(shí)驗(yàn)；第3章介紹基于實(shí)驗(yàn)箱的數(shù)字邏輯綜合實(shí)驗(yàn)；第4章介紹數(shù)字邏輯基礎(chǔ)設(shè)計(jì)、仿真及在實(shí)驗(yàn)箱上進(jìn)行驗(yàn)證；第5章介紹數(shù)字邏輯綜合設(shè)計(jì)、仿真及驗(yàn)證。書的最后還有T3個(gè)附錄，分別為ActelA3P030芯片資料、基于ActelA3P030的FPGA核心板引腳對(duì)應(yīng)表以及FPGA擴(kuò)展實(shí)驗(yàn)板設(shè)計(jì)說明�！稊�(shù)字邏輯與EDA設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書》適合計(jì)算機(jī)、信息、自動(dòng)化、電子專業(yè)的本科生、研究生及從事數(shù)字電路設(shè)計(jì)的工程人員使用。

目錄

第1章 DIGILOGIC-2011實(shí)驗(yàn)箱 1.1 實(shí)驗(yàn)箱的性能特點(diǎn) 1.2 實(shí)驗(yàn)箱的技術(shù)指標(biāo) 1.3 實(shí)驗(yàn)箱介紹 1.3.1 實(shí)驗(yàn)箱的組成 1.3.2 實(shí)驗(yàn)箱及電路板外觀 1.3.3 實(shí)驗(yàn)箱的電路板標(biāo)注 1.3.4 數(shù)碼管電路模塊說明 1.3.5 段式LED顯示驅(qū)動(dòng)板 1.3.6 FPGA擴(kuò)展實(shí)驗(yàn)板設(shè)計(jì) 1.4 實(shí)驗(yàn)箱使用說明 第2章 基于實(shí)驗(yàn)箱的數(shù)字邏輯實(shí)驗(yàn) 2.1 基本門電路 2.1.1 實(shí)驗(yàn)?zāi)康?br />2.1.2 實(shí)驗(yàn)儀器及器件 2.1.3 實(shí)驗(yàn)原理 2.1.4 實(shí)驗(yàn)內(nèi)容 2.1.5 實(shí)驗(yàn)報(bào)告要求 2.2 門電路綜合實(shí)驗(yàn) 2.2.1 實(shí)驗(yàn)?zāi)康?br />2.2.2 實(shí)驗(yàn)儀器及器件 2.2.3 實(shí)驗(yàn)內(nèi)容 2.3 組合邏輯電路 2.3.1 實(shí)驗(yàn)?zāi)康?br />2.3.2 實(shí)驗(yàn)儀器及器件 3.3.3 實(shí)驗(yàn)內(nèi)容 2.3.4 實(shí)驗(yàn)報(bào)告要求 2.4 時(shí)序邏輯電路 2.4.1 實(shí)驗(yàn)?zāi)康?br />2.4.2 實(shí)驗(yàn)儀器及器件 2.4.3 實(shí)驗(yàn)內(nèi)容 2.4.4 實(shí)驗(yàn)報(bào)告要求 第3章 數(shù)字邏輯綜合實(shí)驗(yàn) 3.1 組合邏輯綜合實(shí)驗(yàn) 3.1.1 實(shí)驗(yàn)?zāi)康?br />3.1.2 實(shí)驗(yàn)儀器及器件 3.1.3 實(shí)驗(yàn)內(nèi)容 3.2 時(shí)序邏輯綜合實(shí)驗(yàn) 3.2.1 實(shí)驗(yàn)?zāi)康?br />3.2.2 實(shí)驗(yàn)儀器及器件 3.2.3 實(shí)驗(yàn)內(nèi)容 第4章 數(shù)字邏輯基礎(chǔ)設(shè)計(jì)仿真及驗(yàn)證 4.1 基本門電路 4.1.1 實(shí)驗(yàn)?zāi)康?br />4.1.2 實(shí)驗(yàn)環(huán)境及儀器 4.1.3 實(shí)驗(yàn)內(nèi)容 4.1.3 實(shí)驗(yàn)步驟 4.1.5 實(shí)驗(yàn)報(bào)告要求 4.2 組合邏輯電路 4.2.1 實(shí)驗(yàn)?zāi)康?br />4.2.2 實(shí)驗(yàn)環(huán)境及儀器 4.3.3 實(shí)驗(yàn)內(nèi)容 4.2.4 實(shí)驗(yàn)步驟 4.2.5 實(shí)驗(yàn)報(bào)告要求 4.3 時(shí)序邏輯電路 4.3.1 實(shí)驗(yàn)?zāi)康?br />4.3.2 實(shí)驗(yàn)環(huán)境及儀器 4.3.3 實(shí)驗(yàn)內(nèi)容 4.3.4 實(shí)驗(yàn)步驟 4.3.5 實(shí)驗(yàn)報(bào)告要求 第5章 數(shù)字邏輯綜合設(shè)計(jì)仿真及驗(yàn)證 5.1 基于VerilogHDL的組合邏輯綜合實(shí)驗(yàn) 5.1.1 實(shí)驗(yàn)?zāi)康?br />5.1.2 實(shí)驗(yàn)環(huán)境及儀器 5.1.3 實(shí)驗(yàn)內(nèi)容 5.2 基于VerilogHDL的時(shí)序邏輯綜合實(shí)驗(yàn) 5.2.1 實(shí)驗(yàn)?zāi)康?br />5.2.2 實(shí)驗(yàn)環(huán)境及儀器 5.2.3 實(shí)驗(yàn)內(nèi)容 附錄A ActeIA3P030芯片資料 附錄B 基于ActeIA3P030的FPGA核心板引腳對(duì)應(yīng)表 附錄C FPGA擴(kuò)展實(shí)驗(yàn)板設(shè)計(jì)說明 參考文獻(xiàn)

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